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メモリ内計算：DRAM がついに演算を行う寸前

2026/08/27 4:07

メモリ内計算：DRAM がついに演算を行う寸前

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要約▶

日本語訳:

サムスン社は、Hot Chips 2026 で処理内メモリ（PIM）技術を備えた画期的な 16 GB LPDDR5X メモリパッケージを発表した。この革新では計算が DRAM ディーソ内部で行われるため、通常速度を制限する外部インターフェースのボトルネックを回避できる。パッケージは内部帯域幅として 614 GB/s を達成し、これは標準ピンの利用可能な 76.8 GB/s を大きく上回るものであり、高価格帯の $3,499 マックブックプロ（M5 Max）の統合メモリ帯域幅に匹敵する。

実際のテストでは、整数量子化（SINT4/SINT8）を適用した Llama 3.1 8B モデルを用いた短尺 320 トークンの文脈において、サムスンの PIM アーキテクチャは推論を 5.4 秒で完了させたのに対し、標準メモリでは 12.3 秒必要だった。この 4 倍のパフォーマンス向上により、エッジ AI タスクでもプレミアムノートパソコンと同等の速度を実現できながら、メーカーがメインシステムチップや SoC を完全に再設計する必要があるわけではない。

サムスンは、DRAM アドレスを MAC インスルークションに直接マップさせる特別な「Address Align Mode」を通じて後方互換性を達成した。これにより既存のメモリコントローラも新しいハードウェアと動作可能となる。しかしながら、現在のソリューションは特定の構成と整数量子化に依存しており、llama.cpp や vLLM などの主要なオープンソースランタイムからはまだサポートされていない。また、GGUF k-quants ではスケーリング操作が非対応であり対応しておらず、複雑なワークロードを最適化する将来のソフトウェア開発が行われるものの、現時点での制約により広範な適用には限界がある。

今後を見据えると、JEDEC は LPDDR6 スタンダードを発表しており、専用の LPDDR6 PIM スタンダードの開発もほぼ完了しており、より高密度とより狭窄したインターフェースを標的として不均一システムの性能をさらに向上させることを目指している。

本文

Hot Chips 2026: Samsung の新技術「LPDDR5X-PIM」、メモリアンナー処理で帯域幅を 8 倍向上

Samsung は Hot Chips 2026 で、16 GB LPDDR5X メモリパッケージ内における驚異的な性能を発表しました。この発表は、従来のメモリアーキテクチャの限界を突破し、AI 推論の新たな可能性を示すものです。

驚異的な帯域幅の達成

  • 内部帯域幅: パッケージ内で 614 GB/s の高スループットを実現しました。
  • 外部帯域幅との比較:
    • 対比となるのは、外部ピンのみを通る約 76.8 GB/s です。
    • この「内部 vs 外部」の差はなんと 8 倍。
  • 他社製品との比較:
    • この帯域幅は、最高スペックの Apple M5 Max（3,499 ドル版 MacBook Pro）が得られるユニファイドメモリ帯域幅とほぼ同等です。

「メモリアンナー処理（PIM）」の正当性

DRAM バンク自体が帯域幅の大半を担うため、外部ピンのみを最適化してもポテンシャルを十分には引き出すことができません。Samsung の設計思想は、**「最大のデータ転送をメモリパッケージ内部に留める」**ことにあります。

用語解説

  • バンク（Bank）: DRAM は複数の独立した配列「バンク」で構成され並列動作します。LPDDR5X チップには数十個のバンクがあり、内部スループットは莫大ですが、外部への接続インターフェースが細く制限されています。
  • GEMV vs. GEMM:
    • GEMV（行列・ベクトル積）: バッチサイズ 1 の自己回帰型デコードで使用。「活性化（activation）」データの重み行列全体との乗算処理です。PIM は主にこの効率化に寄与します。
    • GEMM（行列・行列積）: プリフィルやバッチ対応サービスで使用されます。
  • PIM（Processing-in-Memory）: 計算ユニットを DRAM バンクのすぐ隣（内部）に配置し、外部インターフェースの帯域ではなく、バンクレベルの高スループットを活用する技術です。
  • 算術強度（Arithmetic Intensity）: 1 バイトあたりに実行される演算数（FLOPs）。値が高いと「計算依存型」、低いと「帯域依存型」になります。LPDDR-PIM は帯域依存型の処理速度を劇的に向上させます。

ボトルネックはメモリ帯域幅

トークン生成には、DRAM からパラメータの読み込み→乗算→捨てるというサイクルが繰り返されます。バッチサイズ 1 のデコードでは重みを再利用できず、算術強度（Arithmetic Intensity）が極めて低く、処理が「帯域依存型」になります。

理論上の上限: 

トーク数/秒 ≒ メモリ帯域幅 (GB/s) ÷ モデルサイズ (GB)

  • 例：614 GB/s の帯域 × 20 GB のモデル = 約 30 トークン/秒 の理論値

現実の速度はこの理論値を下回るため、生成処理中に高価な計算ハードウェアが DRAM 読み込み待ち状態になりがちです。Apple の M5 Pro（307 GB/s）から Ultra（1.2 TB/s）までの性能差も、この「メモリ帯域幅」に依存しています。

Samsung が構築したシステム

システム構成

  • DRAM バンクの隣に 16 つの PIM ブロックを配置。
  • MAC トリーと ALU（浮動小数点・整数演算）が並列動作。
  • JEDEC 標準準拠の 561 ボールパッケージ。
  • 1 ランクあたり 4 チップで、計 16 GB の容量内蔵。
  • サーバー、モバイル、クライアント（同フットプリントの LPDDR5X）に対応可能。

処理ステップ（4 ステップ）

  1. 活性化書込み: ホストからの FP8 データを 16 つの WRPB コマンドでブロードキャスト。
  2. 重み読み込み: PIMX_RD で DRAM セルから 32 バイト分の重みを读取、MAC トリーにマップ。
  3. ベクトル書込み: PIMX_WR で中間和をバンクへ書き戻す（1:1 の固定比率ではない）。
  4. 読み出し: ホストはシングルバンクモードへ切り替え、最大 64 の連続コマンドでデータ排出。

性能と互換性

  • 重み保持: データはパッケージ内に保持され、ホストへ渡るのは小さな活性化データのみです。
  • 精度対応: MAC 精度フィールドを通じて 15 パターンに対応（SINT4: 2.4 TOPS / FP8: 約 1.2 TFLOPS）。
  • 既存コントローラとの共存: 「アドレスアライメントモード」により、既存の DRAM コントローラで動作可能。シングルバンクモード（通常処理）とマルチバンクモード（PIM 処理）を柔軟に切り替えられます。

測定結果：実際のシリコンでの検証

Llama 3.1 8B モデル（コンテキスト長 320 トークン、全量整数化）を用いた比較結果は以下の通りです。

メトリックLPDDR5X (従来)LPDDR5X-PIM (新技術)改善比 (Delta)
実行時間12.3 秒5.4 秒2.28 倍の高速化
スループット27 トークン/秒81.3 トークン/秒3.01 倍の高出力
  • 注: このベンチマークは特定のモデル・短いコンテキスト長・単一アクセラレータに依存しています。KV キャッシュのボトルネックが最小限に抑えられており、すべてのワークロードでこの性能を維持できるかは未確認です。
  • 価格についてはまだ検証済みではなく、広帯域インターフェースとのコスト優位性は主張段階にあります。

ソフトウェア上の課題と壁

現状では llama.cpp や vLLM などの主要実行環境には PIM バックエンドが実装されていません。Samsung が公開している SDK やシミュレータを活用するには、以下の 3 つの壁を乗り越える必要があります。

1. K-quant 形式との互換性問題

  • llama.cpp は GGUF の k-quants（例：Q4_K_M）で高品質を実現していますが、PIM の MAC ユニットはこのスケーリング演算に対応していません。
  • PIM は統一されたフォーマットを使用するため、既存の GGUF ファイルを PIM ネイティブレイアウトへ再量子化する必要があり、品質維持は不透明です。

2. 物理的なメモリ配置の問題

  • OS カーネル（
    mmap
    ）はページを任意の場所に分散して配置しますが、PIM は特定のバンク領域に連続して配置する必要があります。
  • 「バンクを意識したアロケーター」（Huge Page 等）が必要ですが、現在 macOS/Linux/Windows はこれを標準で提供していません。これにより llama.cpp の「メモリマップドモデル読み込み」機能と対立します。

3. GEMV と GEMM のバランス

  • 現在の LPDDR-PIM デザインは GEMV（バッチサイズ 1）に最適化されています。
  • しかし、現代の推論ではバッチ処理や GQA、試行的デコード（Speculative Decoding）など、GEMMを必要とするケースが増えています。
  • GEMV 中心の設計は、高密度な GEMM 操作においてスループットを発揮しきれていない可能性があります。

マルチトークン予測（MTP）との連携

MTP はモデル学習目標としての役割と、推論環境での「試行的ドラフター」としての役割を持ちます。Google の Gemma 4 はこれにより最大 3 倍の高速化を達成していますが、Samsung の設計には以下のような課題があります。

  • 検証ステップの限界: 複数の候補トークンをチェックすると処理が GEMV から GEMM に性質が変わり、PIM のフルスループットは発揮しにくい。
  • 競合問題: PIM が動作中に NPU が DRAM にアクセスするのをブロックしているため、両者が並行して処理するのが困難です。
  • 柔軟なアプローチ: 「PAPI」などの研究アーキテクチャでは、メモリアンナーカーネル（GEMV）を PIM に、計算依存型カーネル（GEMM）を GPU に分割するスケジューラーが提案されています。

アーキテクチャと将来展望

llamacpp アーキテクチャの進化

llama.cpp
    │
    ├─ today (現在) ────────> NPU/GPU <══ 76.8 GB/s ══> パッシブ DRAM
    │
    └─ PIM-aware (PIM 対応化後) ────> 既存の DRAM コントローラー
                                    │
                                    └─(コマンド)─> インバンク MACs @ 614 GB/s

業界全体への重要性

メモリ壁に対する従来の解決策（HBM、広帯域バスなど）は、電力・コスト・パッケージングの複雑さを増大させます。PIM は**「メモリインターフェースを広げずに有効帯域幅を高める」**という新たな選択肢を提供します。

タイムラインと現状

  • LPDDR5X-PIM: Samsung はすでに動作可能なシリコンを持っており、「今すぐ出荷可能」と位置づけています。
  • LPDDR6-PIM: JEDEC 標準化は進行中（2026 年 4 月頃完成見込み）だが、未だ公式発表なし。
  • ソフトウェルの遅れ: アセラレータのソフトウェア開発は通常、ハードウェアから約 1 年遅れます。PIM はカーネルのアロケーターや量子化パイプラインと連携するため、より統合が困難です。

結論：なぜこれが重要なのか

Samsung の発表は、プロセッサ設計に**「DRAM チップ内に残してしまっている帯域幅を暴露（活用可能化）する」**という新しいパラダイムを示しています。

  • ベンチマークの真価: 16 GB パッケージ内で 614 GB/s の内部帯域を実現したことが最も重要です。
  • 将来のシステム: MTP と PIM を組み合わせることで、さらに高速かつ安価な推論が可能になる可能性があります。
  • ソフトウェアの進化: リソース豊富なベンダーによる資金供給とフォーク版 runtime の構築を経て、既存のオープンソース環境に統合されることが期待されます。

PIM は、現在の「メモリアンナー処理」の限界を打破し、ハードウェア設計者に新たな選択肢を提供する画期的な技術です。

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2026/08/29 0:17

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2026/08/29 0:58

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